Software de diseño Quartus® Prime
El intuitivo entorno de diseño de alto desempeño. Desde la entrada del diseño y la síntesis hasta la optimización, verificación y simulación, el software de diseño Quartus® Prime habilita mayores funcionalidades en dispositivos con varios millones de elementos lógicos, lo que les brinda a los diseñadores la plataforma ideal para aprovechar las oportunidades de diseño de última generación.
Todo lo que necesita para diseñar FPGAs, SoCs y CPLDs Altera®
Vea cómo puede diseñar con el software de diseño Quartus® Prime.
Lo nuevo en la versión 25.1
Compatibilidad con dispositivos Agilex
- Se agregó compatibilidad con Agilex™ 3 FPGA serie C.
- Compatibilidad adicional para dispositivos Agilex™ 5 FPGA.
- Compatibilidad adicional de dispositivos con Agilex™ 7 FPGAs series F, I y M.
Mejoras
- Aumento de desempeño en Nios núcleo V/g.
- Reducción de área del 8% con núcleo Nios V/c.
- Ashling RiscFree VS Code Extension - Desarrolle con Nios® V en VS Code.
- Diseño de ejemplo de TinyML: agregue aprendizaje automático a FPGA diseños.
- Linux Reference Designs – Ediciones estándar y regulares para el desarrollo de Linux.
- Compatibilidad con el hipervisor Xen: ejecute aplicaciones FPGA virtualizadas.
- Compatibilidad con RTOS: ahora se admiten Zephyr y Bare Metal; FreeRTOS disponible próximamente.
- Mejoras del instalador: configuración más rápida y flexible con instalación paralela y selección dinámica de componentes para reducir el tiempo de configuración y optimizar el espacio en disco.
- Streaming Debug: depuración de hardware de alta velocidad con transferencia de datos eficiente en tiempo real, configurable a través de Signal Tap (STP).
- Quartus Prime Pro 25.1: introduce modelos funcionales de bus (BFM) nativos Altera AXI4 para mejorar el rendimiento de la simulación y facilitar la integración, lo que permite una transición sin problemas con cambios mínimos.
- Simulación de IP del protocolo del transceptor mejorada: compatibilidad mejorada para protocolos como PCIe, Ethernet, Serial Lite y JESD, con modelos beta para Ethernet y PCIe en 25.1 y simulación y verificación hasta un 50 % más rápidas.
Otras características y mejoras
- Imágenes en contenedores para Quartus Prime Design Suite (QPDS): disponibles en Docker Hub para facilitar la implementación y la compatibilidad con la nube.
- Mejoras en el análisis de sincronización estática: cierre de diseño más inteligente con una categorización de fallas más clara, un nuevo resumen que separa la sincronización y los resultados del asistente de diseño, compatibilidad con rutas de archivos SDC relativas para mejorar la portabilidad y controles MTBF de grano fino a través del ajuste de la velocidad de alternancia.
- Mejoras en la inferencia de RAM: compatibilidad con síntesis mejorada, incluida la inferencia automática de RAM simple de cuatro puertos y compatibilidad completa con configuraciones de habilitación de bytes (5, 8, 9 y 10 bits), lo que permite un control preciso para escribir bytes individuales dentro de una palabra.
- Se mejoraron los filtros de búsqueda del buscador de nodos para incluir varios tipos de interfaz para consultas de búsqueda más rápidas.
Novedades de FPGA versión 25.1 de AI Suite
Compatibilidad con plataformas de desarrollo y dispositivos:
- Soporte beta de Agilex™ 3
- Genere IP de inferencia a partir de FPGA suite de IA utilizando Agilex™ 5 como dispositivo de destino en el archivo de configuración de arch.
- Ejemplo de compatibilidad con diseño en el kit de desarrollo modular Agilex™ 5 FPGA serie E 065B.
- Diseño de ejemplo de SOC con ARM como host.
- Diseño de ejemplo de conexión JTAG sin host.
- Soporte limitado a 2 años de versiones de Quartus Prime Pro.
Características y mejoras de FPGA AI Suite
- Nueva transformación de diseño integrada con IP de inferencia de IA: admite el plegado y la configurabilidad en tiempo de ejecución.
- El calculador de desempeño toma la entrada del usuario del ancho de banda de memoria externa disponible.
- Anteriormente, el estimador de rendimiento suponía un ancho de banda de memoria que el usuario no podía ajustar.
- Es útil para usuarios que diseñan para dispositivos más pequeños, como Agilex 5/3, que podrían tener un ancho de banda de memoria limitado.
- FPGA AI Suite 25.1 pasa a OpenVINO 2024.6.
Modelos, herramientas y actualizaciones de marca de IA
- Compatibilidad con el modelo YoloV7.
- Identifica y localiza objetos dentro de una imagen o video con alta precisión y velocidad. Utilizado en control de calidad industrial, vigilancia, robótica, etc.
- Altera cambio de marca.
- Los paquetes RPM y DEB ahora son "altera-fpga-ai-suite-<versión>".
- AI Suite ahora se instala en '/opt/altera' en lugar de '/opt/intel'.
Novedades de FPGA IP en la versión 25.1
Presentación de las PI de Agilex™ 3
- Soporte de E/S flexible con interfaces de alta tensión y alta velocidad: MIPI D-PHY, LVDS de 1,25 Gbps.
- Sólidas capacidades de transferencia de datos: transceptores de 12,5 Gbps, PCIe 3.0 e IP duras MAC de baja latencia 10GE + 1GE.
- Administre transferencias de datos entre ubicaciones de memoria no contiguas sin sobrecarga de CPU utilizando sSGDMA IP.
- Transferencia de datos de alta velocidad y baja latencia para diversas aplicaciones con SerialLite IV.
- Sincronización de tiempo precisa entre dispositivos de red compatible con TSE-1588.
- Soporte de memoria rentable con LPDDR4 de hasta 2133Mbps.
- Integración perfecta con procesadores ARM Cortex mediante HPS EMIF.
- Sólidas funciones de sincronización para varios convertidores de datos que utilizan JESD204B de 12,5 Gbps.
- Depuración y pruebas exhaustivas de los enlaces del transceptor mediante el Kit de herramientas del transceptor.
- Procesamiento de imágenes y video de alta resolución que utiliza el paquete de IP Video and Vision Processing (VVP).
Actualizaciones de PI de Agilex™ 5
- Presentamos LTPI: El protocolo de próxima generación para DC-SCM 2.0, que ofrece mayor ancho de banda y escalabilidad para la tunelización de señales de baja velocidad sin interrupciones.
- Ajustes en tiempo real de múltiples configuraciones utilizando Reconfiguración dinámica - PMA-D.
- Acceso directo a memoria multicanal (MCDMA) para PCIe 3.0/4.0 x2/x4 compatible con RP y EP.
- Comunicación determinista de baja latencia con Ethernet TSN @ 10M/100M/1/2.5 G + SGMI.
- Interlaken @ 12.5Gbps por carril serie introducido en Agilex 5 Serie D.
- JESD204B hasta 17,16 Gbps con compatibilidad con UTK.
- JESD204C protocolo incluido en el modo Dual-Simplex.
Recursos adicionales
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Consiga el paquete completo de herramientas de diseño Altera® FPGA.
Licencias
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Preguntas frecuentes sobre el software de diseño Quartus® Prime
El software Quartus® Prime habilita una ruta rápida para convertir los diseños de FPGAs, SoCs y CPLDs Altera® en realidad. Proporciona herramientas y características necesarias para ayudar en cada paso, desde la entrada del diseño y la síntesis hasta la optimización, la verificación y la simulación. Consulte el catálogo del software Quartus® Prime para obtener más información.
El software Quartus® Prime Pro Edition y el software Standard Edition requieren una licencia de pago, pero la Lite Edition no tiene licencia. Una suscripción de nodo fijo admite el acceso a Pro Edition y Standard Edition, así como a Questa*-Altera® FPGA Edition, con un año de mantenimiento. Para obtener una licencia, visite nuestro Centro de asistencia para licencias de FPGA.
Si está listo para comprar una licencia o necesita características avanzadas de FPGA y SoC, como compatibilidad con las familias de dispositivos de bajo consumo Agilex™, Stratix® 10, Arria® 10 y Cyclone® 10, compre primero una licencia paga en nuestro Centro de asistencia de licencias de FPGA.
Para comenzar con la versión gratuita del software Quartus® Prime Lite Edition, o para descargar una versión con licencia, visite Descargas del software Quartus® Prime.