ID del artículo: 000095919 Tipo de contenido: Resolución de problemas Última revisión: 31/07/2023

¿Por qué la Intel® FPGA Hard IP Ethernet F-Tile falla en la etapa de generación lógica de compatibilidad de Intel® Quartus® Prime Pro Edition al actualizar un diseño del software Intel® Quartus® Prime Pro Edition versión 23.1 a la versión 2...

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  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descripción

    Debido a un problema en la versión 23.2 del software Intel® Quartus® Prime Pro Edition, la actualización de un diseño de la versión 23.1 que incluye la Intel® FPGA Hard IP Ethernet F-Tile en la que se ha establecido el parámetro de la GUI "Usar inserción de direcciones de origen" provocará un error de "Generación de lógica compatible" en el sistema operativo Windows*.

    Resolución

    Para evitar este problema en el software Intel® Quartus® Prime Pro Edition Software versión 23.2, realice los pasos siguientes:

    1. En su proyecto 23.1, busque el parámetro "bb_f_ehip_mac_txmac_saddr" en el archivo <nombre de variante ethernet>/synth/<ethernet_variant_name>.v
    2. En su proyecto 23.2, busque el parámetro "bb_f_ehip_mac_txmac_saddr" en el archivo <ethernet variant name>/synth/<ethernet_variant_name>.v
    3. Copie el valor del parámetro "bb_f_ehip_mac_txmac_saddr" de 23,1 en el valor del parámetro "bb_f_ehip_mac_txmac_saddr" de 23,2 .
    4. Guarde el archivo 23.2 <nombre de variante ethernet>/synth/<ethernet_variant_name>.v
    5. Vuelva a compilar el proyecto de versión 23.2 del software Intel® Quartus® Prime Pro Edition

    Como alternativa, genere una versión limpia desde cero de la Intel® FPGA Hard IP Ethernet F-Tile en la versión 23.2 del software Intel® Quartus® Prime Pro Edition.

    Está previsto que este problema se solucione en una versión futura del software Intel® Quartus® Prime Pro Edition.

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