ID del artículo: 000092452 Tipo de contenido: Resolución de problemas Última revisión: 18/11/2024

¿Por qué veo problemas de estabilidad en los ejemplos de diseño de JESD204C que utilizan la JESD204C F-Tile FPGA IP en el bucle invertido externo?

Entorno

  • Intel® Quartus® Prime Pro Edition
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descripción

    Debido a un problema en la versión 22.3 del software Quartus® Prime Pro Edition, los ejemplos de diseño JESD204C que utilizan la IP de FPGA F-Tile JESD204C en el bucle invertido externo pueden experimentar problemas de estabilidad.

    Dependiendo de la variante exacta que esté utilizando, estos problemas pueden manifestarse como eventos emb_unlock_err, sh_unlock_err, rx_gb_underflow_err, cmd_par_err, invalid_eoemb, invalid_eomb, invalid_sync_header y lane_deskew_err.

    Resolución

    Hay una revisión disponible para solucionar este problema para la versión 22.3 del software Quartus® Prime Pro Edition.
    Descargue e instale patch 0.11 desde el enlace correspondiente a continuación, luego vuelva a generar su archivo de programación.

    Este problema se solucionó a partir de la versión 22.4 del software Quartus Prime Pro Edition.

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