ID del artículo: 000091371 Tipo de contenido: Fe de erratas Última revisión: 22/08/2023

¿Por qué veo problemas de conexión cuando uso las variantes F-Tile Serial Lite IV Intel® FPGA IP FHT PMA en NRZ F50G y PAM4 F100G?

Entorno

  • Intel® Quartus® Prime Pro Edition
  • Interfaces
  • BUILT IN - ARTICLE INTRO SECOND COMPONENT
    Descripción

    Debido a un problema en la versión 22.2 del software Intel® Quartus® Prime Pro Edition, es posible que tenga problemas de conexión al utilizar las variantes F-Tile Serial Lite IV Intel® FPGA IP FHT PMA en NRZ F50G y PAM4 F100G al ejecutar el TCL de consola del sistema de ejemplo de diseño.

    Resolución

    Para evitar este problema en la versión 22.2 del software Intel® Quartus® Prime Pro Edition, después de generar el ejemplo de diseño de Intel® FPGA IP F-Tile Serial Lite IV, reemplace la expresión de cálculo de carriles como se muestra a continuación en el archivo ed_hwtest/system_console/sliv_ftile.tcl.

    FHT NRZ 48G-58G:

    proc wait_for_pcs_ready { } {

    ...

    Línea 201 : set actual_lane $lanes → set actual_lane [expr $lanes >> 1]

    ...

    }

    proc sl4_link_init_int_lpbk {val} {

    ...

    Línea 1071 : set real_lanes $lanes → set real_lanes [expr $lanes >> 1]

    ...

    }

    FHT PAM4 96G-116G:

    proc wait_for_pcs_ready { } {

    ...

    Línea 199: set actual_lane [expr $lanes >> 1] → set actual_lane [expr $lanes >> 2]

    ...

    }

    proc sl4_link_init_int_lpbk {val} {

    ...

    Línea 1068: set real_lanes [expr $lanes >> 1] → set real_lanes [expr $lanes >> 2]

    ...

    }

    Este problema se solucionó a partir de la versión 22.3 del software Intel® Quartus® Prime Pro Edition.

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